Ich hatte wunderbare Erfolge mit meinem neuen Mojo FPGA, also beschloss ich, etwas Schwierigeres zu versuchen, nämlich eine Schnittstelle mit einer PS/2-Tastatur, aber ich bekomme es nicht zum Laufen. Natürlich habe ich die richtigen Vorkehrungen getroffen, um von 5-V-Signalen auf 3,3-V-Signale zu wechseln (ich versuche derzeit nicht, die Leitungen zu treiben, lese nur davon ab), aber mein einfacher Ansatz, ein Spannungsteiler (sicher, aber nicht immer angemessen ) nicht zum gewünschten Ergebnis geführt. Ich glaube, das liegt daran, dass die Leitungen auf der Tastatur Open Collector sind und einen niedrigen Zustand und einen hohen Impedanzzustand haben. Mir fallen Möglichkeiten ein, dieses Problem möglicherweise zu lösen, aber ich hätte gerne eine zweite Stimme zu diesem Thema. Mein wichtigstes Designziel ist Einfachheit, daher werden Lösungen mit diskreten Komponenten wie Transistoren Lösungen mit ICs wie Operationsverstärkern vorgezogen.
Ich bezweifle, dass das funktionieren wird. Die Ausgangstransistoren auf der 5V-Tastatur haben wahrscheinlich einen das ist zu hoch, um als logisch niedrig am 3,3-V-FPGA-Pin registriert zu werden. Da Sie keine Datenblätter gepostet haben und wahrscheinlich sowieso nichts über die Ausgangstransistoren der Tastatur wissen, ist dies wahrscheinlich der einfachste Weg, um zu sehen, ob es funktioniert.
Da die Ausgänge Open Collector sind, ist die Implementierung jedoch einfach.
Simulieren Sie diese Schaltung – Mit CircuitLab erstellter Schaltplan
Ziehen Sie sie zum Starten mit einem 10k-Widerstand auf 3,3 V hoch. Wenn Sie Probleme mit der Kommunikation haben, verringern Sie den Pull-up-Wert. R2 ist ein Strombegrenzungswiderstand zum Schutz des Pins. Wenn es versehentlich als Ausgang konfiguriert wird, werden Sie froh sein, dass es da ist. C1 ist da, um ein Über- und Unterschwingen zu verhindern und den Stift zu schützen. Es ist optional, und wenn Sie sich dafür entscheiden, müssen Sie sehr vorsichtig sein. Beim Übergang von Low nach High muss es über den Pullup- und Strombegrenzungswiderstand aufgeladen werden. Diese Anstiegszeit muss ausreichend kurz sein, damit sie nicht dazu führt, dass das Timing des Kommunikationsprotokolls verletzt wird. Beim Übergang von hoch nach niedrig, wenn der Transistor einschaltet, entlädt er sich über R2. Diese Abfallzeit wird kürzer sein, also gibt es dort kein Problem.
Jippie
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