Finden Sie den Wert einer Kapazität in einer dynamischen RAM-Zelle? (Digitale Elektronik)

Ich hatte dieses Problem in meinem Digitalelektronik-Abschluss. Ich möchte wissen, wie ich das lösen kann, obwohl ich andere Werte verwenden werde, da ich mich nicht an die genauen Werte aus dem Test erinnere. Ich werde auch meine Lösung aufschreiben, aber ich habe nur diese Lösung gemacht Da ich ähnliche Probleme gesehen habe, verstehe ich die Argumentation nicht oder weiß nicht einmal, ob sie richtig ist. Mein Ziel ist es, dies zu verstehen, da ich das Gefühl habe, jeden anderen Teil des Kurses ziemlich gut verstanden zu haben. Aber die Elektronik war für mich eine große Herausforderung, da ich Computeringenieur bin.

Probleminformationen:

Die folgende Skizze zeigt die Schaltung für eine dynamische RAM-Zelle.

Skizze hier.

Der Transistor ist ein NMOS. v D D = v W L = 3 v , v T = 1 v Wenn es eine Leseoperation gibt, wird BL auf vorgeladen v D D 2 . Die Bitleitungskapazität C B L = 0,1 P F . Bestimmen Sie den Mindestwert für die Zellkapazität C C so dass während eines Lesevorgangs die Spannungsänderung in der BL mindestens 10 mV beträgt. Ignorieren Sie den Körpereffekt.

Meine Lösung:

Für logisch-1 die Spannung in C C , v C C ( 1 ) wäre v W L v T = 3 1 = 2 v .

Für logisch-0 die Spannung in C C , v C C ( 0 ) würde auf 0V abfallen.

Logik-1:

Der Professor hat diese Formel einige Male verwendet, ich kenne die Gründe dafür nicht wirklich. Als ich fragte, sagten sie Energiegespräch. Ich schätze, ich habe das einfach akzeptiert, weil es so aussieht, als würde es Sinn machen. Hier ist es:

C C v C C ( 1 ) + C B L v C B L ( 1 ) = v F ( C C + C B L ) .

Wir kennen also all diese Werte, wir können sie einfügen:

C C 2 v + 0,1 P F 1.5 v = 1.51 v ( C C + 0,1 P F )

Und wir lösen für C C , So C C = 2.04 F F

Logik-0:

Mit der gleichen Formel wie zuvor:

C C v C C ( 0 ) + C B L v C B L ( 0 ) = v F ( C C + C B L ) .

Wir setzen unsere bekannten Werte ein:

C C 0 v + 0,1 P F 1.5 v = 1.49 v ( C C + 0,1 P F )

Wir glauben, dass C C = 0,67 F F .

Abschluss:

Wenn wir logisch-1 haben, brauchen wir eine Zellenkapazität C C = 2.04 F F , und wenn wir eine logische 0 haben, brauchen wir eine Zellenkapazität C C = 0,67 F F , um eine zu haben Δ v B L = 10 M v . Wenn wir die logische 0 gemacht haben C C größer, es würde nur die verursachen Δ v B L höher sein, was in Ordnung wäre. Wenn wir die Logik-1 gemacht haben C C etwas kleiner, dann die Δ v B L wäre weniger als 10mV.

Daher lautet die Antwort C C = 2.04 F F .

Ist das richtig?

Antworten (1)

Ja, das ist richtig. Ich habe die Nummern nicht überprüft, aber das Verfahren ist korrekt.

Damit Sie verstehen, was Sie tun, finden Sie hier eine Erklärung der Formel. Wenn Sie einen Lesevorgang ausführen, schalten Sie das NMOS ein. Das bedeutet, dass Sie irgendwie Cc und die Bitleitung kurzschließen. Dies sind zwei Kondensatoren, die mit unterschiedlichen Spannungen geladen sind. Wenn Sie sie also verbinden, findet eine Umverteilung der Ladungen statt. Die Formel, die Sie verwenden, bezieht sich tatsächlich auf die Ladungserhaltung und nicht auf die Energieerhaltung. Die in einem Kondensator gespeicherte Ladung Q ist gleich seiner Kapazität mal der Spannung an seinen Leitungen:

Q   =   C v
Sie passen also einfach die Ladung an, die vor der Verbindung vorhanden ist, und die Ladung, die danach vorhanden ist, wobei Sie bedenken, dass wir nach dem Kurzschluss den Cc-BL-Kondensator als die Parallele der beiden modellieren können.
Q ich = Q F C C v C C + C B L v C B L = C T Ö T v F
Die Endspannung muss größer sein als v C B L + Δ v wenn wir ein hohes Niveau und weniger als hätten v C B L Δ v wenn wir ein niedriges Niveau hätten. Die Verwendung dieser Bedingung führt zu zwei getrennten Gleichungen, die leicht gelöst werden können:
C C ( 1 ) C B L Δ v v C C ( 1 ) v B L Δ v C C ( 0 ) C B L Δ v v C C ( 0 ) v B L + Δ v

Der höhere Wert der Kapazität ist derjenige, den Sie suchen.