Ich habe einen Kristalloszillator (und CCC) in einem IGLOO2-FPGA-Design von Microchip/Microsemi instanziiert, und das VHDL-Modul des Oszillators hat einen XTL- Eingangspin .
Was ist die richtige Vorbereitung/Verkabelung für die Simulation?
Aus der Dokumentation ist mir nicht klar, was mit diesem Pin zu tun ist:
„Der Quarzoszillator liefert ein Taktsignal von bis zu 20 MHz. Physikalisch erfordert er den Anschluss an einen externen Quarz, für Simulationszwecke liefert der XTL-Pin jedoch ein Taktsignal, das mit der gewünschten Eingangsfrequenz läuft.“
Es ist ein Eingangspin , also wie liefert er ein Taktsignal?
Um es klar zu sagen, meine Frage bezieht sich nicht auf Quarzoszillatoren und wie sie funktionieren, sondern auf die richtige Verkabelung in einer Prüfbank und auf höchster Ebene.
Dezember-Referenz: https://coredocs.s3.amazonaws.com/Libero/11_8_sp4/sf2_mlg.pdf
Mein Verständnis der Beschreibung ist, dass Sie für die Simulation XTL
ein Signal von Ihrer Prüfbank einspeisen, das der Frequenz Ihres Kristalls entspricht, um die Simulation verschiedener Frequenzen zu ermöglichen. Verwenden Sie dann CLKOUT
in Ihrem Design weiter, als ob Sie einen echten Kristall hätten.
Für die Synthese XTL
wird es entweder aus der obersten Ebene herausgeführt und dem richtigen Pin zugewiesen, oder es wird unbeschaltet gelassen, wodurch die Synthese-Tools es automatisch der richtigen Oszillator-Hardware zuordnen. Kann nicht sagen welche.
Tony Stewart EE75
P2000
Mitu Raj
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