Ich werde einen diskreten Delta-Sigma-ADC entwerfen, der auf einer Leiterplatte aufgebaut werden soll. Ich glaube, ich verstehe das Grundkonzept, aber ich werde ziemlich bald Komponenten bestellen müssen. Hier ist mein Problem: Obwohl ich etwas über Operationsverstärker- / Komparatorparameter gelernt habe, weiß ich nicht, welche Parameter ich bei der Auswahl von Teilen für meine Anwendung priorisieren sollte.
Das Design, das ich in Betracht ziehe, wird in etwa so aussehen:
Anmerkungen:
Zusammenfassung: Ich frage mich, ob die Eingangs-Offsets, die sowohl vom Operationsverstärker als auch vom Komparator in der Eingangsstufe eingeführt werden, dazu führen, dass der Integrator erheblich driftet, oder ob der Kondensator schnell genug geladen / entladen wird, damit durch DC-Offsets verursachte Fehler auftreten unerheblich.
Der größte Faktor ist Ihr Quantisierungsrauschen für die Auflösung.
Da Sie keine Spezifikationen angegeben haben, sind eine Priorität für Vio- und Iio-Offsets für Schaltungsbalance, Rauschunterdrückung, Übersprechen, Signalbandbreite und Dezimierungsverhältnis keine genauen Vorschläge möglich. (daher müssen Sie JEDES Design immer mit einer großartigen Spezifikation beginnen )
Um jedoch die Leistung kommerzieller ICs zu erreichen, müssen Sie viele Schleifen und eine Integration höherer Ordnung haben, um das Quantisierungsrauschen weit über die Signalbandbreite zu verschieben. Die Verwendung einer Schaltung, die zweimal statt nur einmal integriert, ist eine großartige Möglichkeit, das bandinterne Quantisierungsrauschen des Modulators zu verringern.
DS-Wandler von Texas Instruments enthalten beispielsweise Modulatoren zweiter bis sechster Ordnung. Modulatoren mehrerer Ordnung formen das Quantisierungsrauschen zu noch höheren Frequenzen als die Modulatoren niedrigerer Ordnung.
ref: Lesen Sie Texas Instruments, Nuts and Bolts des Delta-Sigma-Video-Tutorials [Online]. Verfügbar: http://focus.ti.com/docs/training/catalog/events/event.jhtml?sku=WEB408001
Spannungsspitze
glen_geek
Kaleb Reister
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