Übergangszeit (Anstiegszeit) und Laufzeitverzögerung

Kürzlich bin ich im Unterricht auf die folgende Berechnung der Laufzeitverzögerung der folgenden digitalen Schaltung gestoßen:Geben Sie hier die Bildbeschreibung ein Geben Sie hier die Bildbeschreibung ein

Könnte mir bitte jemand die Addition der Anstiegszeit von X2 und C erklären? Ich verstehe nicht, warum dieser Zusatz als die "echte" Laufzeitverzögerung angesehen wird.

Wurde in der Frage erwähnt, welche Gerätefamilie verwendet wird, CMOS, TTL, ECL usw.? Ich versuche zu verstehen, woher die Division durch 2 kommt.
Ich glaube cmos...
Ich vermute, dass sie mit tr(C) eigentlich tr(Y0) meinen. Die Schwellenspannung für CMOS-Logikpegel beträgt etwa die Hälfte der Versorgungsspannung, daher betonen sie möglicherweise, dass die Anstiegszeit des Eingangssignals zum Erreichen der Schwelle 0 -> 1 (0,5 Versorgungsspannung) nicht Null ist und ebenfalls mit die Ausgangssignalwirkung auf das Zielziel. Ich bin unsicher. Diese Verzögerungen sind im Allgemeinen gering im Vergleich zu anderen Verzögerungen.

Antworten (1)

Ich denke, es liegt an der Art und Weise der Ausbreitungsverzögerung (sagen wir T P L H ) ist definiert. Siehe die Abbildung:

Geben Sie hier die Bildbeschreibung ein

Herkömmlicherweise wird sie zwischen den Mittelpunkten des Übergangs gemessen.

Wenn Sie nun eine echte Laufzeitverzögerung definieren ( T P , R e A l ) als Zeitdauer zwischen dem Punkt, an dem der Eingang zu steigen begann, und dem Punkt, an dem sich der Ausgang auf den Endwert einpendelt, dann kann man schreiben:

reale Ausbreitungsverzögerung = Zeit, die erforderlich ist, damit der Eingang auf 50 % ansteigt + Ausbreitungsverzögerung + Zeit, die erforderlich ist, damit der Ausgang den Endwert vom 50 %-Punkt erreicht.

T P , R e A l = T P L H + T ich N , 0 50 % + T Ö u T , 50 100 %

Deshalb werden die Hälfte der Anstiegszeiten mit der herkömmlichen Laufzeitverzögerung addiert, um die tatsächliche Laufzeitverzögerung zu berechnen .