Wellspuren in PCB [Duplikat]

Mir ist aufgefallen, dass auf einigen Leiterplatten wellige Spuren vorhanden sind.

Ein Beispiel ist auf dem Compute Module IO für Raspberry Pi Compute Module 4 (CM4) zu sehen.

Rechenmodul-E/A-Platine, Beispiel für PCB-Schiene

Anscheinend handelt es sich um Hochfrequenzspuren.

Welche Funktion haben diese Wellen? Wie berechne ich diese Wellen für das Design meiner Platinen mit Hochfrequenzkommunikation?

Ich würde gerne mehr darüber wissen, damit ich es recherchieren kann.

Ich entwickle ein Board mit dem CM4. Also muss ich vielleicht diese Art von Spur benutzen.

Danke

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So wie ich es verstehe, besteht die Hauptfunktion der Wellung darin, dass alle Spuren mit einer bestimmten Funktion die gleiche Länge haben.

Wir müssen die Riffelung dort hinzufügen, wo das Problem beginnt. Wenn wir dies nicht tun, fällt die für die Platine ausgelegte differentielle Impedanz aus.

das wird verwendet, um die Spur auf eine bestimmte Länge zu bringen ... wahrscheinlich um ein Paar Spuren zusammenzubringen
Und sie werden Mäander genannt.
oder Schlangenspuren

Antworten (1)

Hochgeschwindigkeits-Differenzspuren müssen von Ende zu Ende die gleiche Weglänge haben, um eine Laufzeitverzerrung in Differenzen zu verhindern, in diesem Fall auf der anderen Seite. Dies wird häufig für DDR-Speicher durchgeführt.

Aber dieses Beispiel hätte ein suboptimales Übersprechen mit dem gleichen Lückenpaar und benachbarten Spuren, kann aber kein Problem für synchrone Daten sein.

Es könnte auch für einen Unterschied in der Pfadlänge von 20 Pikosekunden zu viel des Guten sein.

Guter Punkt - dieses Bild ist definitiv kein gutes Beispiel. Wenn es eine Spurlängendifferenz gibt, sollte sie in der Nähe des Teils korrigiert werden, das die Differenz verursacht. Andernfalls bewegen sich die Bitflanken nicht ausgerichtet und es gibt eine gewisse Schräglage, die das Signal etwas verschlechtern kann. Es könnte einen Gleichtakt verursachen, der wiederum mit einer Gleichtaktdrossel bekämpft werden könnte.
Ich würde nicht erwarten, dass die Mäanderposition in der gesamten Pfadlänge eine Rolle spielt.
Vielleicht, aber wenn Adern des Paares einen Längenunterschied beginnen und dieser später an anderer Stelle ausgeglichen wird, dann erfährt während dieses Längenunterschieds ein Impuls, der der anderen Ader im Paar vorausläuft, nicht mehr die ausgelegte differentielle Impedanz als Gegensignal kommt zu spät. Die Ausbreitungsverzögerung in FR4 beträgt etwa 6,67 ps/mm. Da es sich um HDMI handelt, ist ein Intra-Pair-Skew von 0,15*Tbit erforderlich. Tbit bei 6 Gbit/s beträgt 167 ps und somit beträgt der maximale Skew 25 ps oder 3,75 mm. Eine Differenz von 25 mm würde die Kanten aufeinanderfolgender Bits ausrichten, obwohl dies eine unrealistisch große Differenz ist.
Sie sagen also, dass Mäandern die Differenzimpedanz beeinflusst, selbst wenn die Single-Ended-Impedanz zur Masseebene konstant ist? Sind die Stöße vom anderen Signalpfad entfernt, die in Zdiff im Vergleich zum Prop-Skew signifikant sind, werden sie eliminiert. Hmmm, deshalb dachte ich, Mäanderposition unten oder oben wäre egal. (Sagen Sie, um einen kürzeren rechtwinkligen Pfad auf der anderen Seite zu korrigieren) @Justme
Ich weiß nicht, wie wichtig das ist, aber beim Hochgeschwindigkeitsdesign wird man in Appnotes immer davor gewarnt. Die charakteristische differentielle Impedanz tritt nur auf, wenn sich ein positives und ein negatives Signal an derselben Stelle ausbreiten, sodass sie sich in der Mitte aufheben. Bei PCIe beträgt die differentielle Impedanz 100 Ohm und die Single-Ended-Impedanz 60 Ohm, sodass die Gleichtaktimpedanz 30 Ohm beträgt. Aus irgendeinem Grund hat der Single-Ended also nicht 50 Ohm.
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